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用VHDL設(shè)計(jì)實(shí)現(xiàn)的有線頂盒信源發(fā)生方案

2、CPLD外部引腳說(shuō)明
來(lái)源:投影時(shí)代 更新日期:2008-06-09 作者:佚名
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   2、CPLD外部引腳說(shuō)明

    該方案中所用的芯片是Xilinx公司的CPLD9500系列芯片,其類(lèi)型為XC95108-7PC84。這種芯片共有84個(gè)外部引腳,其中5個(gè)引腳接地,6個(gè)引腳接電源,4個(gè)引腳用于JTAG,剩下的引腳為I/O引腳。根據(jù)EISA總線的信號(hào)特征和信源的要求,該芯片所使用的外部引腳為如圖1所示。

圖1

圖1

 

    圖1中輸入信號(hào):

    DATA_IN15~0輸入的數(shù)據(jù)信號(hào)

    ADDRESS15~0輸入的地址信號(hào)

    RESET復(fù)位信號(hào)

    AEN地址允許信號(hào)

    CLK輸入時(shí)鐘信號(hào)

    IOWI/O寫(xiě)信號(hào)

    輸出信號(hào):

    IO_CS16位I/O片選信號(hào)

    DATA_OUT7~0輸出的數(shù)據(jù)信號(hào)

    DEN輸出數(shù)據(jù)使能信號(hào)

    DCLK輸出數(shù)據(jù)時(shí)鐘信號(hào)

 

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